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公開日: 2026年8月21日

熱が律速条件になるとき:実装放熱の限界が 2027 年までの OEM・EMS 調達戦略に示すもの

今週公表された研究者の見解では、実装放熱がメモリに代わり AI インフラ拡張の最大の制約となりました。AI プロセッサ単体の TDP は 1kW を超え、ラックは数百キロワットに達する一方、液冷普及率は 2025 年の約 33% から 2026 年 53%、2027 年には 60% 近傍へ上昇します。OEM・EMS にとってこの変化は、案件リスクを半導体の割当から熱管理・給電ハードウェアへ移すもので、既存の調達体制の多くが追跡対象として設計してこなかった領域です。議論されている緩和経路である CPO と STCO は実在しますが、2026 年から 2027 年の日程を変える時間軸にはありません。

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2025 年以降、AI インフラの調達はメモリサイクルに支配されてきました。その理由も明確です。HBM の割当メカニズム、DDR5 とエンタープライズ NAND における契約価格の再設定、そして契約価格とスポット価格の乖離拡大が、案件リスクの発生源について調達部門に明快なモデルを与えてきました。このモデルはおよそ二回の計画サイクルにわたり十分に機能しています。今週の公開議論が示すのは、そのモデルがもはや十分ではないという点です。ラックが出荷できるか否かを決める制約が、メモリの列から完全に外へ移動したためです。

ソウル大学の金成東教授は、この変化を程度ではなく順序の問題として整理し、業界が現在は性能向上よりも熱管理を優先していると指摘しました。これは冷却が難しくなったという観察とは質的に異なる主張です。演算とメモリの実装量を展開できるか否かを規定する前提条件として熱を位置づけるものであり、案件の依存関係において熱管理ハードウェアが半導体コンテンツの上流に来ることを意味します。KAIST の金正浩教授はその機序を 3D 積層に求めています。積層高さが増すほど熱流束は集中し放熱経路は長くなるためで、同教授は研究室において HBM Design AI Agent を用い、手作業の反復に代えて AI による設計自動化とデジタルツインで放熱構造を探索していると説明しました。

定量的な状況もこの順序の入れ替えを裏づけます。NVIDIA、AMD、Google の AI プロセッサ単体はいずれも TDP 1kW を超え、ラック単位のシステムは数百キロワットに達しており、これは従来型の小規模データセンター全体の消費電力に一つのキャビネットで近づく水準です。液冷の普及率は 2025 年の約 33% から 2026 年 53% へ移り、2027 年には 60% に近づきます。運用上重要なのは 2026 年の数値です。普及率が半数を超えるということは、液冷が上位構成ではなくラックの標準アーキテクチャになることを意味し、空冷を基本ケースとする見積テンプレートや能力モデルは、本年下期について系統的に誤った答えを出します。

OEM・EMS にとっての調達上の帰結は、クリティカルパス内部の置き換えではなく、その拡大です。コールドプレートはパッケージ寸法に拘束され、アクセラレータの世代交代に追随して更新されるため、世代間の流用性が低く、シリコンが変わるたびに認定期間が圧縮されます。冗長構成を含むポンプ群は要求信頼性等級が高く、認定サプライヤのリストは短いままです。クイックカプラは漏液リスクがラック停止に直結するため、単価から想定される水準をはるかに超えて認定サイクルが長期化します。高圧直流給電部品は文字どおり新規カテゴリとして加わります。数百キロワット帯のラック電力が配電アーキテクチャ自体を変え、ブスバーと保護ハードウェアをクリティカル BOM に引き込むためです。

これらのカテゴリに共通するのは、従来の半導体調達体制が扱いにくい性質です。アクセラレータやメモリのコンテンツと比べて単価が低く、そのため経営層の案件レビューの外に置かれてきました。サプライヤ基盤は狭く、正規半導体流通の外側に位置することが多いため、過去二年で構築したエスカレーション経路や割当関係が適用できません。そして一点でも欠ければシステム全体を出荷できないため、リスク寄与度は支出額に比例しません。メモリ割当を週次でレビューする一方、熱管理ハードウェアを汎用品目として扱う案件ガバナンスは、実際のリスク分布に対して注意配分を誤っている状態です。

緩和経路は三つが活発に議論されており、いずれもそれ自体としては妥当である一方、共通して時間軸の問題を抱えます。コパッケージドオプティクスは光トランシーバをプロセッサパッケージ内に移し、銅インターコネクトを光信号に置き換えるもので、アーキテクチャの帰結として熱負荷を低減します。SK hynix は 8 月 20 日、バージニア大学 Kyusang Lee 教授ら国際的な研究者との共同研究による CPO ロードマップを Nature Electronics で公表し、ノードあたり帯域 100 Tb/s 超、エネルギー効率 1 pJ/bit 未満、チップ間レイテンシ 10ns 未満を目標として、2D 実装、2.5D インターポーザ、3D ヘテロジニアス集積に及ぶ開発経路を示しました。システム・テクノロジー協調最適化は同じ制約に設計側から接近し、部品単位の最適化ではなく熱の限界をシステムアーキテクチャの前段へ引き上げます。新たなメモリ階層として、積層 NAND による HBF と積層 SRAM による HBS が HBM と並行して登場する見込みで、サムスンの zHBM は HBM5 比で密度 10 倍、エネルギー効率 3 倍、熱抵抗 50% 超の低減をうたっています。

これらの経路はいずれも 2026 年および 2027 年の生産日程を変えません。CPO のロードマップは実装世代を明示的に三段階にわたり、新たなメモリ階層は次世代の製品系列に属します。ここで供給側の制約は問題を緩和するのではなく重ねる方向に働きます。先端実装の生産能力自体が装置納期に規定されており、一般的なエッチングと成膜で 12 か月、ハイエンド後工程装置で 18 か月超、RF 電源で 24 か月という水準にあるためです。熱という課題に対する工学的な解は、他のすべてと同じ遅延曲線の上に届く実装能力を必要とします。

同じ週に、時間軸の対比として有用な材料も示されました。サムスンの HBM4 歩留まりは 2026 年 2 月の量産開始時点の 60% 未満から約 80% へ改善し、6 兆ウォンの温陽 HBM 工場は 9 月着工が決定、平沢 P5 は三棟構造へ移行して生産能力を 1.5 倍に上方修正し 2030 年完工の予定です。歩留まりの改善は 2026 年内に実現する部分であり、工場の産出は着工から量産まで通常 3 年以上を要する前提から 2029 年以降となります。供給側の増分と放熱側の制約は明確に別々の時計の上で動いており、両者を混同すると、二つの次元で同時に楽観的な生産計画が生成されます。

調達部門にとっての実務的な結論は、狭く具体的です。2026 年下期に設計凍結を迎える AI サーバ案件では、熱管理および給電ハードウェアを独立した納期管理と認定サプライヤ名を伴う一級の BOM 項目として扱い、現在メモリ割当に適用しているものと同じレビュー頻度に置く形が妥当です。2027 年以降に納入するラック提案は、液冷を既定前提として建値を組む方が安全です。そして演算部品の納期が案件のクリティカルパスを規定するという前提は、2025 年まで概ね妥当でしたが、これらの案件が実際に破綻する箇所をもはや説明しません。